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作业:计数器仿真实验

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1、手工绘制的RTL图

计数器的实质是累加器,只不过每次进行的是加1操作,所以本实验的想法是用两个加法器,一个用于从0-6,0-7,0-8,0-9每一次加1来计数,另一个是当分别到达需要进行下一次从零计数时对6,7,8分别进行加1,并对此加法器的值进行判断,当大于9时,开始下一个周期的从0-6计数,再配上其他的元件,即可以实现此时序逻辑电路的功能。



2、Quartus扫描生成的RTL图



3、计数器代码



4、时序仿真的波形图


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